Betriebssystembau und Betriebsystembau für Mehrkernsysteme
- Semester:
- Sommersemester
- Leistungspunkte
- 5 (Single Core) bzw. 8 (Multi Core)
- Dozent:
- Daniel Lohmann
- Betreuer:
- Gerion Entrup, Stefan Naumann
- Zeit/Raum:
-
- Vorlesung: Freitag 10:15 bis 11:45 Uhr, SRA Seminarraum (Raum 135, Appelstr. 4, 1.OG)
- Übung: Siehe unten, SRA Seminarraum (Raum 135, Appelstr. 4, 1.OG)
- Stud.IP-Veranstaltung:
- Studiengänge:
-
- Betriebssystembau 5 LP, 2V+2Ü
- Bachelor Informatik: IV
- Bachelor Technische Informatik: IV
- Bachelor E-Technik: diverse Modulgruppen
- Master Informatik: GI
- Master Technische Informatik: GTI
- Master E-Technik: diverse Modulgruppen
- Betriebssystembau für Mehrkernsysteme, 8 LP, 2V+4Ü
- Master Informatik: INF
- Master Technische Informatik: INF
- Betriebssystembau 5 LP, 2V+2Ü
Übung 2 für die Mittwochsgruppe (eigentlich am 1. Mai) wird am Freitag, 03.05.stattfinden.
Bei Fragen können Sie uns jederzeit eine E-Mail schreiben oder gerne auch direkt in unseren Büros vorbeischauen. Betreut wird Betriebssystembau von Daniel Lohmann, Gerion Entrup und Stefan Naumann.
Inhalt der Vorlesung
Ziel der Vorlesung ist die Vermittlung von konzeptionellen Grundlagen und wichtigen Techniken, die für den Bau eines Betriebssystems erforderlich sind. In den vorlesungsbegleitenden Übungen werden diese Kenntnisse praktisch angewendet, indem ein kleines PC-Betriebssystem in kleinen Arbeitsgruppen von Grund auf neu entwickelt wird. Um dies zu bewerkstelligen, sind fundierte Kenntnisse über Aufbau und Funktionsweise der PC-Hardware erforderlich, die ebenfalls in der Lehrveranstaltung vermittelt werden. Dabei werden gleichzeitig Grundlagen aus dem Betriebssystembereich wie Unterbrechungen, Synchronisation und Ablaufplanung, die aus früheren Veranstaltungen (z.B. Grundlagen der Betriebssysteme) weitgehend bekannt sein sollten, wiederholt und vertieft.
Die Vorlesung umfasst folgende Themen:
- Grundlagen der Betriebssystementwicklung
- Unterbrechungen (Hardware, Software, Synchronisation)
- IA-32: Die 32-Bit-Intel-Architektur
- Koroutinen und Programmfäden
- Scheduling
- Betriebssystem-Architekturen
- Fadensynchronisation
- Gerätetreiber
- Interprozesskommunikation
Organisation und Inhalt der Übungen
Ziel der Übungen ist es, schrittweise ein kleines Betriebssystem für den PC zu entwickeln. Für die Bearbeitung der Übungsaufgaben werden Gruppen von je 2 Studierenden gebildet. Zunächst gibt es zwei Varianten der Übungen:
- OOStuBS (Betriebsystembau) ist die klassische Uniprozessorvariante: 5 Leistungspunkte (2V + 2Ü)
- MPStuBS (Betriebssystembau für Mehrkernsysteme) die Variante für moderne Mehrkernrechner: 8 Leistungspunkte (2V + 4Ü)
In den Tafelübungen werden Fragen zum Stoff der Vorlesung geklärt und die Übungsaufgaben vorgestellt. Zusätzlich werden Hintergründe, die für die Aufgaben relevant sind, stärker beleuchtet (z. B. Hardware-Spezifika), Knackpunkte im Design und der Implementierung zusammen besprochen und Lösungen entwickelt. Tafelübungen finden im SRA-Seminarraum (Raum 135, Appelstr. 4, 1. OG) statt. Da die Bearbeitung einer Aufgabe in der Regel zwei Wochen beansprucht, finden Tafelübungen nicht wöchentlich statt (siehe Semesterplan).
Rechnerübungen finden im SRA-Rechnerlabor (Raum 124, Appelstr. 4, 1. OG) statt, wo zu den entsprechenden Zeiten mindestens ein Betreuer anwesend ist. Auch außerhalb der dedizierten Zeiten können Sie bei Fragen gerne bei uns vorbeischauen.
Semesterplan
Woche | Di 12:30 | Di 14:00 | Mi 12:30 | Mi 14:00 | Fr 10:15 |
---|---|---|---|---|---|
08.04 | VL1Einführung | Ü0C++ | VL2BS-Entwicklung | ||
15.04 | Ü1Ein-/Ausgabe | RÜ | Ü1Ein-/Ausgabe | RÜ | Karfreitag |
22.04 | RÜ | RÜ | RÜ | RÜ | VL3IRQs (Hardware) |
29.04 | Ü2IRQ-Behandlung | A1Abgabe 1 | 1. Mai | 1. Mai | VL4IRQs (Software) Ü2IRQ-Behandlung für Mittwochsgruppe |
06.05 | RÜ | RÜ | RÜ | A1Abgabe 1 | VL5IRQs (Synchronisation) |
13.05 | Ü3IRQ-Synchronisation | A2Abgabe 2 | Ü3IRQ-Synchronisation | A2Abgabe 2 | VL6Intel IA-32 |
20.05 | RÜ | RÜ | RÜ | RÜ | VL7Koroutinen und Fäden |
27.05 | Ü4Fadenumschaltung | A3Abgabe 3 | Ü4Fadenumschaltung | A3Abgabe 3 | VL8Scheduling |
03.06 | RÜ | RÜ | RÜ | RÜ | VL9Architekturen |
10.06 | Pfingsten | ||||
17.06 | Ü5Zeitscheiben-Scheduling | A4Abgabe 4 | Ü5Zeitscheiben-Scheduling | A4Abgabe 4 | VL10Fadensynchronisation |
24.06 | RÜ | RÜ | RÜ | RÜ | VL11Gerätetreiber |
01.07 | Ü6Fadensynchronistion | A5Abgabe 5 | Ü6Fadensynchronistion | A5Abgabe 5 | VL12Ausblick |
08.07 | Ü7Anwendung (opt) | RÜ | Ü7Anwendung (opt) | RÜ | |
15.07 | RÜ | A6Abgabe 6 | RÜ | A6Abgabe 6 |
Es finden 2 Übungsslots pro Woche statt, wovon jeder Student nur einen besuchen muss. Das bedeutet, dass wir die gleiche Übung zweimal pro Woche halten um eine kleinere Gruppengröße zu erreichen. Ein Übungstermin kann dabei aus einem Tafelübungsteil (Ü1Ein-/Ausgabe) in dem die nächste Aufgabe vorgestellt wird, einer betreuten Rechnerzeit (RÜ), und einem Abgabetermin (A1Abgabe 1) bestehen.
Bedingt durch den 1. Mai wird für die Mittwochsgruppe in dieser Woche ein außerplanmäßiger Termin angeboten werden. Der genaue Termin wird in der Veranstaltung besprochen werden.
Vorkenntnisse
-
Grundlagen aus dem Betriebssystembereich wie Unterbrechungen, Synchronisation und Ablaufplanung aus früheren Veranstaltungen (wie Grundlagen der Betriebssysteme)
-
Wiederholung und Vertiefung in Vorlesung und Übung
-
C / C++ und Assembler (x86)
- Wichtige Inhalte werden in den Übungen vermittelt
- Hilfe bei Bedarf
Evaluation
- SS24 • Übung • Daniel Lohmann • Evaluation (PDF) • Bewertung: 1.4
- SS24 • Vorlesung • Daniel Lohmann • Evaluation (PDF) • Bewertung: 1.1
- SS23 • Übung • Daniel Lohmann • Evaluation (PDF) • Bewertung: 1.1
- SS23 • Vorlesung • Daniel Lohmann • Evaluation (PDF) • Bewertung: 1.1
Anmeldung und weitere Infos
Für diese Veranstaltung ist eine Online-Anmeldung über Stud.IP erforderlich. Bitte registrieren Sie sich (falls noch nicht geschehen) für Stud.IP und tragen Sie sich dort in die entsprechende Veranstaltung ein.
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